Verilog自制NIOS2外设，Avalon总线上的HelloWorld
虚无的目录 嘿嘿嘿，开新坑 这个时候有个CPU来测试就太好了 总线 这次只用到下面几个必要的信号 接下来干什么 自制外设的代码 Qsys配置新组件 连接到Nios内核 配置顶层连接 来吧，eclipse 没用？这就对了 内存一致性问题 新姿势以后接着讲 嘿嘿嘿，开新坑 一开始想写一个SDRAM控制器，和FTDI一些芯片的通信，可是看了很多文章介绍，用Verilog写却又不知如何下手。SDRAM控制
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