DDR学习笔记（一）-FPGA驱动DDR时时钟、突发长度的关系

时间 2019-12-10

标签 ddr 学习笔记 fpga 驱动时钟突发长度关系繁體版

原文原文链接

在使用FPGA驱动DDR2时，若是使用IP核例化接口驱动，需了解如下数据关系：spa 若是DDR2的驱动时钟是200MHz，则DDR2实际工做在400MHZ，若是IP核（DDR控制器）数据接口工做时钟是100MHz，那么IP核（DDR控制器）接口数据宽度是DDR2颗粒数据宽度的4倍。例如，若是DDR2颗粒是16bit，那么DDR控制器数据接口就是64bit。从这里也能够得出

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