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使用Sigrity进行走线阻抗与耦合度检查
时间 2021-01-14
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Sigrity
信号完整性
阻抗耦合检查
Trace Imp/Cpl/Ref Check
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使用Sigrity进行走线阻抗与耦合度检查 Layout中对于走线最基础的关注点是阻抗和串扰。对于阻抗,在开始设计PCB之前,我们会计算出满足阻抗要求的单端走线以及差分线等。对于串扰则是通过设置走线与走线之间的间距。这两者我们都会在设计的时候将参数填写到规则管理器中进行布线约束。 但实际设计中通常不能完全遵守设计规则,比如在Fanout区域需要降低走线线宽等,这也是区域规则存在的原因。除了这种由于
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