波特率发生器--verilog实现

时间 2020-07-26

标签波特率发生器 verilog 实现繁體版

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功能：波特率指的是数据对载波的调制速率，他用单位时间内载波调制状态改变次数来表示。波特率发生器的做用是从输入时钟转换出须要的波特率Clkweb 功能说明:该模块接收任意频率的输入频率（clock）,输出频率（baud_rate）由baud_freq和baud_limit_i根据如下公式计算，使用时首先须要根据输入频率和输出频率计算出baud_freq和baud_limit这两个参数。svg 计

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