试用D触发器和4选1数据选择器74153设计一个双向4位移位寄存器, 具体要求见下表(A、B为控制端), 左移串行输入信号为L, 右移串行输入信号为R

时间 2020-12-26

标签数字电路繁體版

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A B 输出 0 0 保持原状态 0 1 右移 1 0 左移 1 1 清零由题目要求, 绘制状态表. 四位双向移位寄存器状态表 A B Q0* Q1* Q2* Q3* 输出 0 0 Q0 Q1 Q2 Q3 保持 0 1 R Q0 Q1 Q2 右移 1 0 Q1 Q2 Q3 L 左移 1 1 0 0 0 0 清零将状态表转换为状态激励表. 四位双向移位寄存器状态激

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1. 试用D触发器和4选1数据选择器74153设计一个双向3位移位寄存器, 具体要求见下表(A、B为控制端), 左移串行输入信号为L, 右移串行输入信号为R
2. 用D触发器和必要的门电路设计一个2位双向移位寄存器. 具体要求见下表(A、B为控制端), 左移串行输入信号为L, 右移串行信号为R
3. CD4052 作为信号输入选择器(例如串口信号选择)
4. 8位并行输入串行输出的移位寄存器的Verilog描述
5. 试用D触发器和必要的门电路(或最小数量的中规模集成电路芯片)设计两位串行输入、并行输出双向移位寄存器. 寄存器有X、K两个输入端, K控制移位方向, X输入数据(题目全文见本博文示)
6. 以同步右移移位寄存器为基础, 设计0010111序列信号发生器
7. 以同步右移移位寄存器为基础, 设计001011序列信号发生器
8. 以同步右移移位寄存器为基础, 设计001010序列信号发生器
9. ※以同步左移移位寄存器为基础, 设计001010序列信号发生器(对比以同步右移移位寄存器为基础, 设计001010序列信号发生器)
10. 8位并入，1位串出的移位寄存器
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