基于FPAG的简易数字频率计设计

时间 2020-12-30

标签 FPGA fpga verilog 繁體版

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一、设计要求 1、设计四位十进制的简易数字频率计，能够利用系统时钟产生1KHZ-9999KHZ方波信号，并且设计模块对1KHZ-9999KHZ的方波信号进行频率测量； 2、测量的方波频率值要在4位数码管上进行显示 3、此频率计要设有一个整体复位控制（有reset 按键），可恢复初始状态； 4、利用2个按键控制方波频率在1KHZ-10MHZ可调，步进1kHZ。1个按键按下频率增加1KHZ，另外一个

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