FPGA作业3：定时产生脉冲计数序列
本次实验完成的是仿照FPGA_start_lab4_doc.pdf完成的学生实验第1、2、4项内容，主要包括： 1、带使能的计数器的计数范围是0-15 2、把上述计数器的结果通过HEX LED显示出来 3、基础计时器以及带使能的计数器添加必要的清零、暂停功能。 电路原理图说明：CLK50为50KMZ时钟输入，清零端RC由button0控制，暂停端STOP由button1控制，使能输出EN_OUT由
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