filelist文件

时间 2021-01-17

标签 FPGA 繁體版

原文原文链接

利用vivado的命令生成文件列表，导出给第三工具使用：当利用vivado导入一个工程文件夹后：它可以自动分析出文件的层次，以及文件的综合顺序： report_compile_order -used_in synthesis -of [get_ips ip_name] 把上面文件拷贝到notepad简单收到修改即可使用对于synplify: 添加文件的命令 add_file –verilog

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