Quartus PLL分频
在Quartus中实现PLL分频，输入FPGA引脚上的25MHz的时钟，配置PLL使其输出四路分别为12.5Mhz，25Mhz，50Mhz和100MHz的时钟信号。 选择菜单Tools–>Mega Wizard Plug-In Manager选项 点击next 点击i/o中的ALT[LL,右上角的器件选择根据自己选择，保存路径建议先在整个工程文件夹中建立ip_core—>pll文件夹，这里路劲直接
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