【原创】Altera：A10 DDR3 IP核配置教程

时间 2020-12-27

标签 FPGA fpga 繁體版

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【原创】Altera：A10 DDR3 IP核配置教程本文为明德扬原创文章，转载请注明出处！本次分享的是基于Altera的A10 DDR3的IP核配置具体操作。关于DDR IP核的接口配置，参考的是avalon-mm协议，想要了解更多关于avalon-mm协议，大家可以查看的相关资料。一、新建工程用Quartus 18版本新建一个工程，可命名为“A10_ddr3_test”（如下图

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