ADI推出AD9528 JESD204B时钟和SYSREF发生器

1:根据ADI官网上对9361的介绍，其中还提到了与9361相配套的电源，时钟，LNA，PA等等功能部分须要的芯片，具体网页：https://www.analog.com/en/products/ad9361.html

2:MATLAB Filter Design Wizard for AD9361 

3:关于AD9371调试笔记(https://blog.csdn.net/qq_20785973/article/details/83278990)

4:AD9371介绍,有不少相关应用介绍 (http://www.hqchip.com/gongsi/newinfo_3373.html)

5: 不少参考资料和视频https://www.analog.com/cn/products/ad9361.html#product-reference

ADI近日宣布推出 AD9528 JESD204B 时钟和 SYSREF 发生器，以知足长期演进(LTE)和多载波 GSM 基站设计、防务电子系统、RF试验仪器和其余新兴宽带 RF GSPS 数据采集信号链的时钟要求。随着数据速率进入数千兆级，多通道同步和数据延迟管理成为系统必不可少的一部分，将 JESD204B 标准运用在高速转换器-数字处理器接口的作法在诸多最新应用中日益盛行。JESD204B 接口专门针对高数据速率系统设计需求而开发，AD9528 时钟器件内置能够支持和加强该接口标准特性的独特功能。

 

 
ADI推出AD9528 JESD204B时钟和SYSREF发生器

AD9528 提供低功耗、多路输出时钟分配功能，具备低抖动性能，还配有片内集成两级锁相环 (PLL) 和电压控制振荡器 (VCO)。片内 VCO 的调谐范围为3.6 GHz 至4.0 GHz，搭载的输入接收器和振荡器可同时提供单端和差分工做模式。

AD9528 提供与 JESD204B 兼容的子类 1 SYSREF 和肯定性延迟时钟信号，而且支持多种 SYSREF 信号发生选项。最基本的是一个简单的缓冲功能，其中，由用户提供的SYSREF信号被扇出至SYSREF输出引脚。若是为其提供外部SYSREF源，AD9528还能将SYSREF输出同步到内部产生的时钟输出，这是实现精确肯定性延迟的必要条件。AD9528也能在内部生成 SYSREF 源。AD9528 既支持连续信号SYSREF发生，也支持“n次”脉冲生成。对于向其提供时钟的数据转换器，连续信号可能致使转换器输出频谱中出现无用杂散，在这种系统中，N次生成相当重要。

当链接到恢复的系统参考时钟和 VCXO 时，AD9528 产生1 MHz 至400 MHz 范围的12路低噪声输出，以及两路高速输出（最高1.25 GHz）。一路时钟输出相对于另外一路时钟输出的频率和相位可经过分频器相位选择功能改变，该功能用做无抖动的时序粗调，其调整增量至关于 VCO 输出信号的半个周期。每一个 SYSREF 信号都有额外的相位偏移能力，这样，在每一个目标器件处，输入最佳到达时间就变很是简单。

报价与供货

产品	样片供货	全面量产	千片订量报价	封装
AD9528BCPZ	如今	如今	8.25美圆/片	72引脚LFCSP
AD9528/PCBZ 评估板	如今	如今	190.00美圆/片	不适用

运用 ADI 的AD9680双通道、14位、1.0 GSPS JESD204B ADC，能够把 AD9528 用在宽带 RF 数据采集应用设计中。