xilinx IP核设计 FIR滤波器【小白专属大佬勿喷傻瓜教程】

时间 2021-07-13

标签 FIR滤波器 Verilog FPGA 赛灵思繁體版

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1、滤波器阶数的获得采样filter solutions软件实现方法【lmplementation】选择数字方式【Digtal】，滤波器类型为FIR 选择滤波器阶数及截止频率选择滤波器方式这里我们选择低通接下来选择采样频率 FPGA的时钟为50M 这里我们选择50M 最后选择加窗类型到此为止数字滤波器·设置完毕整个设计完成界面如下接下来查看抽头系数点击Transfer Func

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